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DS92LV3241
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DS92LV3241

  • Category:Serial EEPROM
  • Product Name:20-50 MHz 32-bit channel serial link two
  • Manufacturers:NSC
  • Production Batch Number:10+
  • Encapsulation:TQFP64
  • Stock Status:There is stock
  • Stock Quantity:20000
  • Minimum order quantity: 1
  • Details:Haga clic aquí para encontrar un PDF del DS92LV3241
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  • Product introduction

peculiarity

  • Reloj integrado de amplio rango de funcionamiento para SER/DES
  • LVCMOS paralelos de datos de hasta 32 bits
  • Reloj paralelo de 20 a 50 MHz
  • Hasta 1,6 Gbps de datos de aplicaciones paylod
  • Simplified clock architecture
  • There is no separate serial clock line
  • No hay un reloj de referencia necesario
  • Bloqueo aleatorio del receptor de datos
  • La conexión serie de acondicionamiento de señal en chip es robusta
  • Send pre-emphasis
  • Datos aleatorios
  • DC balanced coding
  • El canal de recepción está sesgado
  • Soporta CAT hasta 10 metros - 1.6Gbps en el 5to
  • Terminal LVDS integrado
  • Pruebas integradas de terminal a terminal de terminal a sistema de velocidad AT, BIST
  • Aislamiento de interconexión acoplada a CA y protección contra fallos
  • Protección ESD de HBM > 4kV
  • Space-saving 64-pin TQFP package
  • Full industrial temperature range: -40 ° to +85 ° C

illustrate

El DS92LV3221 (SERVICE) serializa datos de datos de 32 bits en 2 relojes integrados para canales serie LVDS con una tasa de carga útil de datos que supera las trazas de cables FR-4 como CA o cables FR-4 de placa posterior a buses de 1,6 Gbps. Los canales de datos serie deserializados de 2 LVDS del DS92LV3222 (DES) desvían los cambios de retardo de canal a canal y los convierten en flujos de datos LVDS LVDS de bus de datos paralelo de 32 bits.

La aleatorización/aleatorización de datos en chip y la codificación balanceada de CC y el énfasis previo en serie opcional garantizan una transmisión robusta y de baja EMI de cables y placas posteriores largos y con pérdida. El bloqueo automático del deserializador elimina la necesidad de un modo de sincronización de reloj de referencia externo o datos entrantes especiales, proporcionando una operación simple de "enchufar y bloquear".

Al integrar la carga útil de datos, incluidas las funciones de acondicionamiento de la señal de reloj, el dispositivo SerDes de conteo de bucle segundo canal reduce el seguimiento, elimina los problemas de compensación, simplifica el esfuerzo de diseño y reduce el costo de varios conectores para aplicaciones de video, control e imágenes de cable/uno. La verificación integrada de la integridad del enlace en la función BIST de alta velocidad AT se puede utilizar para realizar diagnósticos del sistema.


apply

  • Industrial imaging (machine vision) and control
  • Security cameras and infrastructure
  • Medical imaging

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